专为互联网基础设施提供高效能时脉解决方案的领导厂商Silicon Labs（芯科实验室有限公司,NASDAQ:SLAB）今日推出专为伺服器、储存和交换器之资料中心应用而设计的PCI Express（PCIe） Gen1/2/3扇出缓冲器。

专为互联网基础设施提供高效能时脉解决方案的领导厂商Silicon Labs（芯科实验室有限公司,NASDAQ:SLAB）今日推出专为伺服器、储存和交换器之资料中心应用而设计的PCI Express（PCIe） Gen1/2/3扇出缓冲器。针对x86主机板和伺服器系统，新型Si5310x/11x/019 PCIe缓冲器是业界最高能效的扇出缓冲器，并扩展了Silicon Labs不断成长的PCIe时序产品线。藉由弹性的输出数量选项，新型PCIe缓冲器能够完整满足98% 基于x86的伺服器/储存设备主机板的设计需求。

长久以来，资料中心设备制造商必须在有限的供应商中选择透过主要x86 CPU和晶片组供应商认证的PCIe Gen3缓冲器。这些传统的PCIe缓冲器通常基于十分耗电的恒流输出技术，每一输出至少需要4个外部终端电阻器以及一个参考电阻器，因此增加了物料清单（BOM）成本。随着能耗和散热成本逐渐成为资料中心设计的关键所在，开发人员越来越倾向于寻求既能提供最大能源效率又符合x86主机板严格规格的时序产品。Silicon Labs的Si5310x/11x/019系列产品能够为设备制造商提供低功耗、标准相容的PCIe缓冲器产品，这些产品不仅通过主要x86 CPU和晶片组供应商的认证，而且也具备强大的技术支援。

超过90%的现有主机板设计依旧采用基于恒流输出技术的PCIe缓冲器。为满足这些现有市场需求，Silicon Labs新型Si53019 PCIe恒流缓冲器提供了一个完全认证的直接替换相容解决方案，并且相较于传统解决方案能耗可减少30%。

为了进一步降低功耗，Silicon Labs的Si5310x和Si5311x元件使用创新的推挽输出架构，可提供业界最低能耗的PCIe缓冲器系列产品。这些元件比恒流缓冲器减少60%的功耗，同时减少每路输出所需的外部电阻器，显着减少外部元件数量，简化了印刷电路板（PCB）的设计。例如，透过使用Silicon Labs的19路输出的Si53119推挽缓冲器代替传统的恒流元件，开发人员将能节省近1W的能耗，并且减少39个外部元件。

针对采用新型基于ARM®SoC的超大型伺服器和储存市场的系统设计，Silicon Labs的Si5310x和Si5311x推挽输出晶片也是最佳的PCIe时序解决方案。与基于x86的设计相似，应用于伺服器和储存设备的ARM-based SoC平台，使用PCIe作为主要的系统资料汇流排和互连方式。随着系统级能效逐渐成为超大型架构的关键所在，采用推挽输出的新型Si5310x和Si5311x元件便成为伺服器和储存平台设计的理想选择（无论其采用何种CPU架构）。

能耗考量外，资料中心设备的制造商也面临着保持讯号完整性的挑战，因其通常需要在长达60寸的电路板之间传输时脉讯号。在如此长的距离中，PCIe时脉的上升和下降时间将延长并变慢，这也导致抖动性能降低，系统掉封包率升高。Silicon Labs的PCIe Gen3缓冲器设计能够提供长距离时脉讯号传输，同时保持相容标准的PCIe上升和下降时间规格，进而防止抖动增加和掉封包的状况。

Silicon Labs的新型PCIe缓冲器系列产品支援6、8、12、15、19路输出，同时具有恒流和推挽输出缓冲器，这使得开发人员能为每个应用打造最佳的时序解决方案。Silicon Labs的元件与传统PCIe缓冲器接脚和功能相容，透过强化能源效率、讯号完整性和抖动性能，可提供开发人员最佳方案。

Silicon Labs时脉产品行销总监James Wilson表示：“行动互联网流量和云端运算正推动着更快、更高效能的资料中心设备选择支援PCIe标准和主要x86规范的高精度时序解决方案。我们已经扩展了PCIe时序产品线，现在包括完全符合x86规范的PCIe Gen3扇出缓冲器，将能大幅降低资料中心设备的功耗、成本和复杂性。新型的PCIe产品有效补足了Silicon Labs的任意频率时脉产生器系列，为伺服器、交换器和储存设计提供了单晶片时脉树解决方案。”

Silicon Labs提供广泛的时脉产品线，包括频率弹性的时脉产生器、抖动衰减器、时脉缓冲器、PCIe时脉和振荡器等以满足各类物联网基础设施应用。这些高效能的时序解决方案让开发人员能藉由单一供应商一站式购齐，为资料中心、核心网路、无线基础设备、宽频存取以及测试和测量设计提供满足需求的完整时序解决方案。

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